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COP8SGK640N6

COP8SGK640N6首页预览图
型号: COP8SGK640N6
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功能描述: 8-Bit CMOS ROM Based and OTP Microcontrollers with 8k to 32k Memory, Two Comparators and USART
PDF文件大小: 913.32 Kbytes
PDF页数: 共62页
制造商: NSC[National Semiconductor]
制造商LOGO: NSC[National Semiconductor] LOGO
制造商网址: http://www.national.com
捡单宝COP8SGK640N6
PDF页面索引
120%
14.0 Instruction Set (Continued)
14.8 OPCODE TABLE
Upper Nibble
FE D C BA98765 4 3 2 10
Lower Nibble
JP−15 JP−31 LD 0F0, #i DRSZ 0F0 RRCA RC ADC
A,#i
ADC
A,[B]
IFBIT
0,[B]
ANDSZ
A, #i
LD
B,#0F
IFBNE 0 JSR
x000–x0FF
JMP
x000–x0FF
JP+17 INTR 0
JP−14 JP−30 LD 0F1, #i DRSZ 0F1 * SC SUBC
A, #i
SUBC
A,[B]
IFBIT
1,[B]
*LD
B,#0E
IFBNE 1 JSR
x100–x1FF
JMP
x100–x1FF
JP+18 JP+2 1
JP−13 JP−29 LD 0F2, #i DRSZ 0F2 X A,[X+] X
A,[B+]
IFEQ
A,#i
IFEQ
A,[B]
IFBIT
2,[B]
*LD
B,#0D
IFBNE 2 JSR
x200–x2FF
JMP
x200–x2FF
JP+19 JP+3 2
JP−12 JP−28 LD 0F3, #i DRSZ 0F3 X A,[X−] X
A,[B−]
IFGT
A,#i
IFGT
A,[B]
IFBIT
3,[B]
*LD
B,#0C
IFBNE 3 JSR
x300–x3FF
JMP
x300–x3FF
JP+20 JP+4 3
JP−11 JP−27 LD 0F4, #i DRSZ 0F4 VIS LAID ADD
A,#i
ADD
A,[B]
IFBIT
4,[B]
CLRA LD
B,#0B
IFBNE 4 JSR
x400–x4FF
JMP
x400–x4FF
JP+21 JP+5 4
JP−10 JP−26 LD 0F5, #i DRSZ 0F5 RPND JID AND
A,#i
AND
A,[B]
IFBIT
5,[B]
SWAPA LD
B,#0A
IFBNE 5 JSR
x500–x5FF
JMP
x500–x5FF
JP+22 JP+6 5
JP−9 JP−25 LD 0F6, #i DRSZ 0F6 X A,[X] X
A,[B]
XOR
A,#i
XOR
A,[B]
IFBIT
6,[B]
DCORA LD
B,#09
IFBNE 6 JSR
x600–x6FF
JMP
x600–x6FF
JP+23 JP+7 6
JP−8 JP−24 LD 0F7, #i DRSZ 0F7 * * OR A,#i OR A,[B] IFBIT
7,[B]
PUSHA LD
B,#08
IFBNE 7 JSR
x700–x7FF
JMP
x700–x7FF
JP+24 JP+8 7
JP−7 JP−23 LD 0F8, #i DRSZ 0F8 NOP RLCA LD A,#i IFC SBIT
0,[B]
RBIT
0,[B]
LD
B,#07
IFBNE 8 JSR
x800–x8FF
JMP
x800–x8FF
JP+25 JP+9 8
JP−6 JP−22 LD 0F9, #i DRSZ 0F9 IFNE
A,[B]
IFEQ
Md,#i
IFNE
A,#i
IFNC SBIT
1,[B]
RBIT
1,[B]
LD
B,#06
IFBNE 9 JSR
x900–x9FF
JMP
x900–x9FF
JP+26 JP+10 9
JP−5 JP−21 LD 0FA, #i DRSZ 0FA LD
A,[X+]
LD
A,[B+]
LD
[B+],#i
INCA SBIT
2,[B]
RBIT
2,[B]
LD
B,#05
IFBNE 0A JSR
xA00–xAFF
JMP
xA00–xAFF
JP+27 JP+11 A
JP−4 JP−20 LD 0FB, #i DRSZ
0FB
LD
A,[X−]
LD
A,[B−]
LD
[B−],#i
DECA SBIT
3,[B]
RBIT
3,[B]
LD
B,#04
IFBNE 0B JSR
xB00–xBFF
JMP
xB00–xBFF
JP+28 JP+12 B
JP−3 JP−19 LD 0FC, #i DRSZ
0FC
LD
Md,#i
JMPL X A,Md POPA SBIT
4,[B]
RBIT
4,[B]
LD
B,#03
IFBNE 0C JSR
xC00–xCFF
JMP
xC00–xCFF
JP+29 JP+13 C
JP−2 JP−18 LD 0FD, #i DRSZ
0FD
DIR JSRL LD A,Md RETSK SBIT
5,[B]
RBIT
5,[B]
LD
B,#02
IFBNE 0D JSR
xD00–xDFF
JMP
xD00–xDFF
JP+30 JP+14 D
JP−1 JP−17 LD 0FE, #i DRSZ
0FE
LD A,[X] LD
A,[B]
LD [B],#i RET SBIT
6,[B]
RBIT
6,[B]
LD
B,#01
IFBNE 0E JSR
xE00–xEFF
JMP
xE00–xEFF
JP+31 JP+15 E
JP−0 JP−16 LD 0FF, #i DRSZ 0FF * * LD B,#i RETI SBIT
7,[B]
RBIT
7,[B]
LD
B,#00
IFBNE 0F JSR
xF00–xFFF
JMP
xF00–xFFF
JP+32 JP+16 F
Where, i is the immediate data Md is a directly addressed memory location * is an unused opcode The opcode 60 Hex is also the opcode for IFBIT #i,A
COP8SG Family
www.national.com53
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