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AS7C3364PFD32B-200TQIN

AS7C3364PFD32B-200TQIN首页预览图
型号: AS7C3364PFD32B-200TQIN
PDF文件:
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功能描述: 3.3V 64K X 32/36 pipeline burst synchronous SRAM
PDF文件大小: 549.22 Kbytes
PDF页数: 共19页
制造商: ALSC[Alliance Semiconductor Corporation]
制造商LOGO: ALSC[Alliance Semiconductor Corporation] LOGO
制造商网址: http://www.alsc.com
捡单宝
PDF页面索引
100%
February 2005
Copyright © Alliance Semiconductor. All rights reserved.
®
AS7C3364PFD32B
AS7C3364PFD36B
3.3V 64K X 32/36 pipeline burst synchronous SRAM
1/31/05; v.1.1 Alliance Semiconductor P. 1 of 19
Features
Organization: 65,536 words × 32 or 36 bits
Fast clock speeds to 200 MHz
Fast clock to data access: 3.0/3.5/4.0 ns
•Fast OE
access time: 3.0/3.5/4.0 ns
Fully synchronous register-to-register operation
Double-cycle deselect
Asynchronous output enable control
Available in 100-pin TQFP package
Linear or interleaved burst control
Individual byte write and global write
Snooze mode for reduced power-standby
Common data inputs and data outputs
Multiple chip enables for easy expansion
3.3V core power supply
2.5V or 3.3V I/O operation with separate V
DDQ
Logic block diagram
Q0
Q1
64K × 32/36
Memory
array
Burst logic
CLK
CLR
CE
Address
DQ
CE
CLK
DQ
d
CLK
DQ
Byte write
registers
register
DQ
c
CLK
DQ
Byte write
registers
DQ
b
CLK
DQ
Byte write
registers
DQ
a
CLK
DQ
Byte write
registers
Enable
CLK
DQ
register
Enable
CLK
DQ
delay
register
CE
Output
registers
Input
registers
Power
down
4
36/32
161416
16
GWE
BWE
BW
d
ADV
ADSC
ADSP
CLK
CE0
CE1
CE2
BW
c
BW
b
BW
a
OE
A[15:0]
ZZ
LBO
OE
CLK CLK
36/32
36/32
DQ [a:d]
Selection guide
–200 –166 –133 Units
Minimum cycle time 5 6 7.5 ns
Maximum clock frequency 200 166 133 MHz
Maximum clock access time 3.0 3.5 4 ns
Maximum operating current 375 350 325 mA
Maximum standby current 130 100 90 mA
Maximum CMOS standby current (DC) 30 30 30 mA
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